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RT Book, Whole SR Print DC OPAC T1 わかるVerilogHDL入門 : 文法の基礎から論理回路設計,論理合成,実装まで / 木村真也著 T2 トランジスタ技術Special A1 木村, 真也 YR 2006 FD 2006.7 SP 279p ED 改訂新版 PB CQ出版 PP 東京 SN 9784789837569 LA Japanese (日本語) NO 参考・関連文献: p276 NO 書誌ID=1000085502; NCID=BA7737896X; LK [OPAC]https://libop-nifs.nifs.ac.jp/opac/opac_link/bibid/1000085502 LK [Webcat Plus]http://webcatplus-equal.nii.ac.jp/libportal/DocDetail?hdn_if_lang=jpn&txt_docid=NCID:BA7737896X; [Webcat Plus]http://webcatplus-equal.nii.ac.jp/libportal/EqualFromForm?txt_isbn=9784789837569 OL 58